Circuit intégré 74595

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Le circuit intégré 74595 ^[1]^, ^[2]^, ^[3]^, ^[4]^, ^[5]^, ^[6]^, ^[7] fait partie de la série des circuits intégrés 7400 utilisant la technologie TTL.

Ce circuit est un registre à décalage de 8 bits à entrée série et sorties parallèles avec registre de stockage.

Il est apparu au début des années 1980 en version TTL Low Power Schottky (54/74LS595)^[1] puis en version HCMOS (54/74HC595, incompatible TTL, qui reproduit la fonction logique et le brochage liés à la référence 74595)^[2].

Contenu du circuit

Le 74595 est constitué :

d'un registre à décalage de 8 bits à entrée série (SER) et sortie série (Q_H‘), disposant d'une entrée de commande (SRCK) active sur front montant et d'une entrée de remise à zéro (¬SRCLR) active à l'état bas ;
d'un registre de stockage (latch) de 8 bits disposant d'une entrée de commande (RCK). Un front montant sur cette entrée provoque la mémorisation des 8 bits du registre à décalage ;
d'un tampon de sortie à trois états exposant les 8 bits du registre de stockage, avec une entrée de commande (¬G). Un état haut sur cette entrée désactive les sorties (Q_A à Q_H).

Mode d'utilisation

À la mise sous tension, les contenus du registre à décalage et celui du registre de stockage sont aléatoires.

À tout moment, les huit bits du registre à décalage peuvent être forcés à 0 en appliquant un niveau bas (0) sur l'entrée ¬SRCLR.

Les bits de donnée sont transmis un à un au registre à décalage par l'entrée série SER sur les fronts montants du signal d'horloge SRCK. Le huitième bit du registre à décalage (le plus ancien) est disponible sur la sortie Q_H‘.

Les huit bits contenus dans le registre à décalage à un instant donné sont mémorisés dans le registre de stockage en appliquant un front montant sur l'entrée RCK du circuit. Les signaux d'entrée ¬SRCLR, SRCK et SER n'ont aucun effet sur le contenu du registre de stockage. Les huit bits mémorisés dans registre de stockage sont disponibles sur les sorties Q_A à Q_H quand un niveau bas (0) est appliqué sur l'entrée ¬G.

Chaînage

Plusieurs circuits 74595 peuvent être chaînés pour constituer un registre à décalage plus long (deux circuits pour 16 bits, trois circuits pour 24 bits, quatre circuits pour 32 bits, etc.). Dans ce cas de figure, l'entrée série (SER) des circuits 74595 supplémentaires est connectée à la sortie série (Q_H‘) du circuit qui le précède dans la chaîne. Les entrées de commande (SRCK, ¬SRCLR, RCK et ¬G) des circuits supplémentaires reçoivent les mêmes signaux que le premier circuit.

Signaux

Description des broches
#Broche (DIP16)	Symbole et variantes^†			Description
10	¬SRCLR	¬SCLR	¬MR	Entrée de remise à zéro du registre à décalage (active à l'état bas)
11	SRCK	SCK	SHCP	Entrée d'horloge du registre à décalage (active sur front montant)
14	SER	SI	DS	Entrée de donnée série du registre à décalage
9	Q_H’		Q7S	Sortie du dernier étage du registre à décalage
12	RCK		STCP	Entrée d'horloge du registre de stockage (active sur front montant)
13	¬G		¬OE	Entrée d'activation des sorties du registre de stockage (active à l'état bas)
15	Q_A		Q0	Sorties du registre de stockage
1	Q_B		Q1
2	Q_C		Q2
3	Q_D		Q3
4	Q_E		Q4
5	Q_F		Q5
6	Q_G		Q6
7	Q_H		Q7
8	GND			Masse (0 V)
16	V_CC			Alimentation
† : la désignation des broches du circuit varie d'un constructeur à l'autre. Les symboles à gauche dans la colonne du tableau, qui sont par ailleurs utilisés dans cet article, correspondent au document de spécifications du circuit SN74LS595 de Texas Instruments donné en lien.

Tables de vérité


Table de vérité du registre à décalage seul
Entrées			États internes								Sortie
¬SRCLR	SRCK	SER	a	b	c	d	e	f	g	h	Q_H’
0	x	x	0	0	0	0	0	0	0	0	0
1	0	x	Inchangé								Inchangé
1	↑	0	0	a	b	c	d	e	f	g	g
1	↑	1	1	a	b	c	d	e	f	g	g
1	1	x	Inchangé								Inchangé
1	↓	x	Inchangé								Inchangé


Table de vérité du registre de stockage
Entrées		États internes								Sorties
RCK	¬G	A	B	C	D	E	F	G	H	Q_A	Q_B	Q_C	Q_D	Q_E	Q_F	Q_G	Q_H
0	0	Inchangé								A	B	C	D	E	F	G	H
0	↑	a	b	c	d	e	f	g	h	a	b	c	d	e	f	g	h
0	1	Inchangé								A	B	C	D	E	F	G	H
0	↓	Inchangé								A	B	C	D	E	F	G	H
1	0	Inchangé								Haute impédance
1	↑	a	b	c	d	e	f	g	h	Haute impédance
1	1	Inchangé								Haute impédance
1	↓	Inchangé								Haute impédance


Notes :
0 = niveau logique bas 1 = niveau logique haut x = sans importance ↑ = front montant (transition bas → haut) ↓ = front descendant (transition haut → bas) Dans les lignes des tables relatives aux fronts montants ou descendants des signaux (↑ et ↓), les valeurs logiques indiquées représentent l'état d'entrée immédiatement avant la transition, et l'état interne ou l'état de sortie immédiatement après la transition.

Diagramme logique

Chronogramme

Applications

Le 74595 est principalement utilisé dans la conversion de données série-parallèle.

Notes et références

↑ ^{a et b} (en) Datasheet SNx4LS595/SNx4LS596, Texas Instruments, 1981 rev. 1988
↑ ^{a et b} (en) Datasheet SNx4HC595, Texas Instruments, 1982 rev. 2021
↑ (en) Datasheet SNx4HCT595, Texas Instruments, 2021
↑ (en) Datasheet 74HC595, Diodes Incorporated, 2018
↑ (en) Datasheet 74HC595/74HCT595, Nexperia, 2021
↑ (en) Datasheet M74HC595, STMicroelectronics, 2014
↑ (en) Datasheet SN74AHC595, Texas Instruments, 1996 rev. 2015

Voir aussi

Liens internes

Liens externes

(en) Spécifications des circuits 74595 et 74596 (SN54LS595, SN54LS596, SN74LS595, SN74LS596 8-bit Shift Registers with Output Latches), Texas Instruments, janvier 1981, rev. mars 1988
(en) Datasheet des circuits 74AHC595 et 74AHCT595, Nexperia, mai 2020

Portail de l’électricité et de l’électronique

[ls_ti_ds1981-1] {a et b} (en) Datasheet SNx4LS595/SNx4LS596, Texas Instruments, 1981 rev. 1988

[hc_ti_ds1982-2] {a et b} (en) Datasheet SNx4HC595, Texas Instruments, 1982 rev. 2021

[hct_ti_ds2021-3] (en) Datasheet SNx4HCT595, Texas Instruments, 2021

[hc_di_ds2018-4] (en) Datasheet 74HC595, Diodes Incorporated, 2018

[hct_np_ds2021-5] (en) Datasheet 74HC595/74HCT595, Nexperia, 2021

[hc_st_ds2014-6] (en) Datasheet M74HC595, STMicroelectronics, 2014

[ahc_ti_ds1996-7] (en) Datasheet SN74AHC595, Texas Instruments, 1996 rev. 2015

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